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时间频率学报
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SDH E1时隙可配帧格式及数据编码的设计与FPGA实现技术
文章来源: 发布时间:2019-04-11 字体大小:【

  池飞1,2,3,4,5,武建锋1,2,3,4,何在民1,2,3 

  1.中国科学院国家授时中心,西安710600 

  2.中国科学院精密导航定位与定时技术重点实验室,西安710600 

  3.中国科学院时间频率基准重点实验室,西安710600 

  4.中国科学院大学电子电气与通信工程学院,北京101048 

  5.中国科学院大学,北京 100049 

  摘要:SDHsynchronous digital hierarchy)光纤网络在电力、通信和交通等行业存在广泛的应用,E1通道具有可靠?#38498;?#31283;定性高的特点,可采用E1通道实现整个SDH光纤网络的时间同步。在介绍E1帧格式及HDB3编码原理的基础上,同时兼顾SDH光纤网络数据传输核心业务,设计并实现了时隙可配的SDHE1帧格式,针对传统SDHE1帧格式?#21152;?#26102;隙固定、灵活性差等不足,设计了E1可配置时隙的帧格式传输结构,基于FPGAfield programmable gate array)实现了时码信息在E1帧格式31时隙中?#25105;?#19968;个时隙的HDB3编码发送,验证了E1可配时隙帧格式生成和HDB3编解码的可行性及正确性。该设计极大增强SDH光纤网络时间同步的灵活性,提高了用户使用的便捷性。 

  关键词:SDHE1;可配时隙;数据编码;帧格式;现场可编程门阵列 

  DOI10.13875/j.issn.1674-0637.2018-04-0317-09   

  引用格式:池飞,武建锋,何在民,等. SDH E1时隙可配帧格式及数据编码的设计与FPGA实现技术[J].时间频率学报,201841(4)317-325. 

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